高频时钟优势及低能电源芯片

发布时间:2020-11-2 阅读量:1072 来源: 我爱方案网 作者: 我爱方案网

部分GSPSADC可使快速输入时钟倍数在ADC内部分割,以得出实际的采样时钟。在这种情况下对ADC使用更高速率的采样时钟的优势和劣势是什么。与仅允许一个选项以1×实际采样速率输入时钟频率不同,部分ADC允许使用更高倍率的时钟速率,例如2×、4×或8×采样速率。然后可对ADC进行配置,将更高频率的时钟从内部分割为将模拟信号采样到ADC的更低时钟倍率。此类配置有几个优点。


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第一个优点就是系统板现可使用相同的硬件和时钟解决方案应付多个采样速率。在这种情况下,使用较快或较慢采样速率只需要略微更改ADC的软件寄存器即可。例如,以最高时钟速率使用ADC的电气测试和测量解决方案,如数字采样示波器,现在只需触摸GUI按钮,就能为最终用户提供多种采样速率选项。如此,还可对仅存在软件版本差异的相同电路板进行市场细分。第二个优点是,与使用更低的1×采样速率相比,使用更高时钟频率的ADC性能更高。更高频率的时钟提供更快的信号压摆率,因此本身具有更精确的边沿和更低的抖动。如前所述,假设ADC抖动不是限制性能的因素,则更低抖动的时钟本身可实现更低的NSD和更高的SNR。


第三个优点是,可消除计时装置和板上走线的一个附加时钟频率。这使得系统能够以更小的时钟信号倍数工作,并且降低了整体计时复杂性。RF时钟信号可能被用作允许较慢采样时钟使用内部分割功能的部分ADC的输入。这种采样配置的一个潜在难题是需要确定能够在增大的频率倍数下实现低抖动的实际计时装置。由于具有更高频率、性能和通道数的时钟解决方案已经发布并应用于系统板,此难题在某种程度上已经缓和。但是,对更高采样速率转换器和复杂配套时钟装置的无止境需求依然没有减少。


电源管理芯片(PMIC)是用于管理或转换系统(手机、平板电脑或汽车ECU)内部功率的集成电路。低功率PMIC,比如移动电话和其他空间有限的手持设备中使用的PMIC可直接安装到PCB上,是设备的电源或电池与复杂电子器件之间的重要接口。DC-DC电源转换器许多应用常见的一种PMIC,其中功率转换电路用于将直流电源的电压电平上变频或下变频为另一个电压电平。标准的DC-DC转换器测试序列可测量电压准确度、效率、线性/负载调整率和瞬态响应等性能标准。


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当输出一个作为输入电池反馈电压的电压时,会关注DC-DC转换器消耗的电流。两个有用的电流参数是器件的关断电流和静态电流。关断电流:如果要运行DC-DC转换器,电压必须连接到SHDN引脚。将SHDN引脚连接至GND或逻辑低电平会将芯片置于关断模式。转换器在该状态下消耗的电源电流,该电流称为关断电流。静态电流:静态电流指DC-DC转换器的另一端不施加任何负载时消耗的电源电流。为了分析这个特性,可以监测以100μV增量扫描电源电压时


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